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Russell King bac51ad9d1 ARM: invalidate L1 before enabling coherency ... We must invalidate the L1 cache before enabling coherency, otherwise secondary CPUs can inject invalid cache lines into the coherent CPU cluster, which could then be migrated to other CPUs. This fixes a recent regression with SoCFPGA randomly failing to boot. Fixes: 02b4e2756e ("ARM: v7 setup function should invalidate L1 cache") Signed-off-by: Russell King <rmk+kernel@arm.linux.org.uk>		10 years ago
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Kconfig	…
Makefile	…
abort-ev4.S	…
abort-ev4t.S	…
abort-ev5t.S	…
abort-ev5tj.S	…
abort-ev6.S	…
abort-ev7.S	…
abort-lv4t.S	…
abort-macro.S	…
abort-nommu.S	…
alignment.c	…
cache-aurora-l2.h	…
cache-fa.S	…
cache-feroceon-l2.c	…
cache-l2x0.c	…
cache-nop.S	…
cache-tauros2.c	…
cache-tauros3.h	…
cache-v4.S	…
cache-v4wb.S	…
cache-v4wt.S	…
cache-v6.S	…
cache-v7.S	…
cache-xsc3l2.c	…
context.c	…
copypage-fa.c	…
copypage-feroceon.c	…
copypage-v4mc.c	…
copypage-v4wb.c	…
copypage-v4wt.c	…
copypage-v6.c	…
copypage-xsc3.c	…
copypage-xscale.c	…
dma-mapping.c	…
dump.c	…
extable.c	…
fault-armv.c	…
fault.c	…
fault.h	…
flush.c	…
fsr-2level.c	…
fsr-3level.c	…
highmem.c	…
hugetlbpage.c	…
idmap.c	…
init.c	…
iomap.c	…
ioremap.c	…
l2c-common.c	…
l2c-l2x0-resume.S	…
mm.h	…
mmap.c	…
mmu.c	…
nommu.c	…
pabort-legacy.S	…
pabort-v6.S	…
pabort-v7.S	…
pageattr.c	…
pgd.c	…
proc-arm7tdmi.S	…
proc-arm9tdmi.S	…
proc-arm720.S	…
proc-arm740.S	…
proc-arm920.S	…
proc-arm922.S	…
proc-arm925.S	…
proc-arm926.S	…
proc-arm940.S	…
proc-arm946.S	…
proc-arm1020.S	…
proc-arm1020e.S	…
proc-arm1022.S	…
proc-arm1026.S	…
proc-fa526.S	…
proc-feroceon.S	…
proc-macros.S	…
proc-mohawk.S	…
proc-sa110.S	…
proc-sa1100.S	…
proc-syms.c	…
proc-v6.S	…
proc-v7-2level.S	…
proc-v7-3level.S	…
proc-v7.S	…
proc-v7m.S	…
proc-xsc3.S	…
proc-xscale.S	…
pv-fixup-asm.S	…
tcm.h	…
tlb-fa.S	…
tlb-v4.S	…
tlb-v4wb.S	…
tlb-v4wbi.S	…
tlb-v6.S	…
tlb-v7.S	…